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工作職責(zé)
1）負(fù)責(zé)編寫FPGA模塊方案。
2）負(fù)責(zé)FPGA模塊RTL開發(fā)。
3）負(fù)責(zé)RTL模塊仿真，驗(yàn)證。
4）負(fù)責(zé)與FPGA模塊同步Matlab仿真驗(yàn)證。
5）負(fù)責(zé)與相關(guān)領(lǐng)域協(xié)助調(diào)試FPGA功能。
崗位要求
1、具有理學(xué)/工學(xué)相關(guān)專業(yè)的本科或以上學(xué)歷。
2、精通VHDL或VERILOG等開發(fā)語(yǔ)言進(jìn)行FPGA設(shè)計(jì)，熟悉FPGA的時(shí)序約束和優(yōu)化方法，有較好的數(shù)字電路基礎(chǔ)。
3、具有用FPGA實(shí)現(xiàn)算法的能力，能獨(dú)立承擔(dān)項(xiàng)目，有獨(dú)立負(fù)責(zé)FPGA設(shè)計(jì)的項(xiàng)目經(jīng)驗(yàn)。
4、了解無(wú)線通信基本原理，具備無(wú)線通信算法分析能力。
特殊要求
有無(wú)線通信系統(tǒng)項(xiàng)目經(jīng)驗(yàn)優(yōu)先。
有GNSS項(xiàng)目經(jīng)驗(yàn)優(yōu)先。
有UVM經(jīng)驗(yàn)優(yōu)先。