職位描述
C++PythonVerilogFPGA/ASIC分子動力學(xué)MD密度泛函理論DFT
崗位職責(zé)
- 負責(zé)FPGA/ASIC創(chuàng)新設(shè)計，聚焦科學(xué)計算、人工智能等芯片的體系架構(gòu)創(chuàng)新，完成原型開發(fā)和驗證
- 承擔(dān)邏輯模塊詳細設(shè)計、仿真驗證、時序分析、資源優(yōu)化和上板測試驗證
- 承擔(dān)邏輯單元測試、系統(tǒng)測試，負責(zé)測試驗證策略、測試方案輸出和覆蓋率分析
- 承擔(dān)FPGA/ASIC各類通用模塊的平臺化設(shè)計和優(yōu)化，負責(zé)自研芯片技術(shù)原型和FPGA驗證平臺的構(gòu)建和維護。
- 計算機、電子、自動化等相關(guān)專業(yè)本科及以上學(xué)歷
- 具備良好的溝通能力、團隊協(xié)作能力、學(xué)習(xí)能力，能夠融入團隊
- 精通Verilog，SystemVerilog，Ｃ++、Python等邏輯編程語言
- 熟悉Linux系統(tǒng)，熟練掌握Vivado、VCS等工具
- 有扎實的數(shù)電功底，能夠設(shè)計分析硬件描述代碼
- 有高性能計算加速經(jīng)驗者優(yōu)先
- 有分子動力學(xué)、密度泛函理論等理論計算知識者優(yōu)先
工作地點
岳麓區(qū)長沙半導(dǎo)體技術(shù)與應(yīng)用創(chuàng)新研究院
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姬先生/人力主管
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廣東芯培森技術(shù)有限公司廣東芯培森技術(shù)有限公司創(chuàng)辦于2024年11月，主要從事面向原子級科學(xué)計算的算力芯片（APU）的研發(fā)和銷售。該團隊于2022年研發(fā)出面向原子級科學(xué)計算的第一代"非馮·諾依曼"專用芯片架構(gòu)技術(shù)，并于2023年自主研制出基于第一代技術(shù)的服務(wù)器產(chǎn)品，經(jīng)多家第三方用戶實測，該產(chǎn)品在運行專用原子級科學(xué)計算時，同等精度和功耗下，相較高端GPU速度提升約1個數(shù)量級。目前，基于第一代技術(shù)的產(chǎn)品和服務(wù)已銷售至國內(nèi)外30多家企業(yè)、高校、科研院所。
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