職位描述
C++Verilog HDLPython
崗位內(nèi)容：
1. 設(shè)計數(shù)字信號處理電路和FPGA原型。
2. 編寫Verilog HDL代碼，進(jìn)行模擬仿真、綜合和布局布線。
3. 完成FPGA驗(yàn)證測試，并發(fā)現(xiàn)并解決設(shè)計問題。
4. 實(shí)現(xiàn)FPGA設(shè)計規(guī)格書，包括架構(gòu)、設(shè)計、實(shí)現(xiàn)和驗(yàn)證。
任職要求：
1. 精通數(shù)字電路設(shè)計和FPGA設(shè)計流程。
2. 具有豐富的HDL編程經(jīng)驗(yàn)，熟練使用Verilog HDL語言。
3. 對數(shù)字信號處理和FPGA設(shè)計算法有深入了解。
4. 熟悉EDA工具鏈，如Vivado、Quartus等。
5. 有良好的溝通、團(tuán)隊(duì)協(xié)作能力和問題解決技巧。
6. 本科及以上學(xué)歷，專業(yè)是電子、通信、計算機(jī)或相關(guān)領(lǐng)域。
工作地點(diǎn)
小店區(qū)太原市小店綜改示范區(qū)大昌路69號宇翔大廈7層
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太原斯利德電子技術(shù)有限公司太原斯利德電子技術(shù)有限公司成立于1999年,是一家專門從事電磁兼容研究的公司,是經(jīng)山西省科技廳認(rèn)定的高新技術(shù)企業(yè)、山西省民營科技型企業(yè)。公司主要開發(fā)、設(shè)計、生產(chǎn)加固型計算機(jī)及外設(shè).公司自成立以業(yè)，本著“幫客戶實(shí)現(xiàn)愿望、幫員工實(shí)現(xiàn)價值、幫企業(yè)創(chuàng)造效益”的理念，借鑒先進(jìn)管理機(jī)制，不拘一格引進(jìn)、培養(yǎng)人才，堅(jiān)持“質(zhì)量就是生命”的原則，為廣大客戶提供優(yōu)質(zhì)的服務(wù)，同時也歡迎計算機(jī)、電子、結(jié)構(gòu)、電磁兼容等各專業(yè)的技術(shù)人才加盟公司，我們將給您提供一個廣闊的發(fā)展空間。
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