職位描述
SerDesCadenceSynopsysVerilog HDL
崗位職責：
1. 進行serdes中PCS的功能驗證與設計;2. 進行serdes中均衡算法的功能驗證與設計;
3. 進行數(shù)字濾波器的設計與驗證；
4. 維護混合仿真的數(shù)字模型。
崗位要求：
1. 微電子、電子工程相關專業(yè)碩士學歷；
2. 熟悉IC設計流程，掌握數(shù)字電路與模擬電路基礎知識；
3. 熟悉IC設計工具，如Cadence、Synopsys等公司的開發(fā)環(huán)境；
4. 具有verilog代碼編寫經歷，熟悉數(shù)字設計和驗證流程，有混合信號的仿真經驗更佳。
2. 熟悉IC設計流程，掌握數(shù)字電路與模擬電路基礎知識；
3. 熟悉IC設計工具，如Cadence、Synopsys等公司的開發(fā)環(huán)境；
4. 具有verilog代碼編寫經歷，熟悉數(shù)字設計和驗證流程，有混合信號的仿真經驗更佳。
工作地點
濟南歷城區(qū)未來創(chuàng)業(yè)廣場3號樓18層
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山東芯慧微電子科技有限公司山東芯慧微電子科技有限公司，創(chuàng)立于2019年7月，創(chuàng)業(yè)團隊來自于中科院電子所可編程芯片與系統(tǒng)研究室。公司堅持用戶導向、創(chuàng)新驅動，秉承中科院“解決國家戰(zhàn)略和經濟社會發(fā)展重大科技問題”的使命。瞄準航天、軍工、信息安全、工業(yè)控制、通信等行業(yè)需求，研制自主可控的大規(guī)模、高可靠FPGA芯片產品。面向人工智能、數(shù)據(jù)中心等新興產業(yè)需求，研發(fā)新型可編程深度學習神經網絡陣列FPNA芯片。針對關鍵專用芯片國產化替代需求，研發(fā)時鐘芯片和紅外焦平面讀出電路芯片，同時，提供高性能集成電路設計服務。
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