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崗位描述 1.負(fù)責(zé)模擬IC中關(guān)鍵電路IP的設(shè)計工作，根據(jù)項目需求完成 ADC/DAC、wireline 等相關(guān)電路架構(gòu)設(shè)計與方案制定，確保電路性能達(dá)到行業(yè)領(lǐng)先標(biāo)準(zhǔn)，滿足產(chǎn)品在高精度、高速率等方面的應(yīng)用需求。 2.負(fù)責(zé)電路的仿真驗證，運(yùn)用平臺仿真工具對設(shè)計電路進(jìn)行全面、細(xì)致分析，及時發(fā)現(xiàn)并解決潛在問題，優(yōu)化電路性能，保障設(shè)計方案的可行性與可靠性，為產(chǎn)品的穩(wěn)定量產(chǎn)奠定基礎(chǔ)。 3.與跨部門團(tuán)隊緊密協(xié)作，包括芯片架構(gòu)、數(shù)字設(shè)計、測試驗證等團(tuán)隊，積極參與技術(shù)評審會議，溝通設(shè)計方案與技術(shù)難點，確保項目順利推進(jìn)，并為團(tuán)隊提供專業(yè)的技術(shù)支持與指導(dǎo)。 專業(yè)要求 1.碩士及以上學(xué)歷，電子、通信等相關(guān)專業(yè)，8年以上模擬IC行業(yè)工作經(jīng)驗。 2.有豐富的 ADC/DAC 或 wireline 電路設(shè)計項目經(jīng)驗，熟悉該領(lǐng)域主流技術(shù)與行業(yè)發(fā)展趨勢。 3.熟練掌握模擬IC設(shè)計全流程，精通 Cadence 等專業(yè)設(shè)計與仿真工具，能夠獨立完成電路原理圖設(shè)計、版圖規(guī)劃與驗證。 4.具備扎實的電路理論基礎(chǔ)與問題分析解決能力，對信號處理、噪聲分析等有深入理解。 5.對智能EDA領(lǐng)域有濃厚興趣，有使用AI輔助電路設(shè)計或參與相關(guān)工具開發(fā)經(jīng)驗者優(yōu)先。 6.具備良好的團(tuán)隊協(xié)作能力、溝通能力與創(chuàng)新思維，能夠適應(yīng)快節(jié)奏的研發(fā)環(huán)境，承擔(dān)復(fù)雜項目的技術(shù)攻關(guān)任務(wù)。